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發(fā)布時間:2023-02-16作者來源:薩科微瀏覽:2776
如曲線①所示,輸入電壓較低時就達到了VEN的使能閾值,使能芯片輸出,此時輸出受到輸入波動的影響且上電緩慢,影響了后級電路的工作穩(wěn)定性;
如曲線②所示,輸入電壓VIN上升到70%~80%的時候,VEN才到達使能閾值,此時芯片輸出摒除了輸入電源的不穩(wěn)定階段,上電迅速,輸出平穩(wěn),減小了輸入電壓波動的影響;
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